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当前位置: 首页 资源下载 搜索资源 - vhdl 课程设计

搜索资源列表

  1. diantikongzhiqi

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  2. 本设计是本人的课程设计,基于VHDL的电梯控制器的设计,能够实现12层电梯控制,上下开关,关门延时,提前关门,状态显示,通过波形仿真进行观看结果
  3. 所属分类:VHDL编程

    • 发布日期:2008-10-13
    • 文件大小:69203
    • 提供者:polly
  1. 数字频率计实验报告

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  2. 课程设计要求设计并用FPGA实现一个数字频率计,具体设计要求如下: 测量频率范围: 10Hz~100KHz 精度: ΔF / F ≤ ±2 % 系统外部时钟: 1024Hz 测量波形: 方波 Vp-p = 3~5 V 硬件设备:Altera Flex10K10 五位数码管 LED发光二极管 编程语言:Verilog HDL / VHDL-curriculum design and FPGA design to achieve a digital frequency meter,
  3. 所属分类:VHDL编程

    • 发布日期:2008-10-13
    • 文件大小:144900
    • 提供者:
  1. 《VHDL语言》交通灯控制系统课程设计报告

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  2. 所属分类:源码下载

  1. taxi

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  2. 该程序为东南大学自动化学院数字课程设计的程序,出租车计价器(08级的设计),采用VHDL实现,有详细的设计过程及最总的原理图-The program for the Institute of Automation, Southeast University Digital curriculum design process, the taxi meter (08 designs), the use of VHDL implementation, detailed design process a
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-11
    • 文件大小:2568470
    • 提供者:xiaoyu
  1. 1213

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  2. 是十六位乘加器的VHDL语言描述。是我的课程设计。很好用。成绩是优秀-Is a sixteen by adder VHDL language descr iption. My course design. Good use. Performance is excellent
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-11
    • 文件大小:2202019
    • 提供者:高亮
  1. cpu2

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  2. 另一个简单的16位VHDL的CPU程序~~~包含简单的加减乘除移位等操作,适用于课程设计-Another simple VHDL' s CPU 16-bit program ~ ~ ~ contains simple calculation shift and other operations for course design
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-09
    • 文件大小:1862685
    • 提供者:liuying
  1. poc

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  2. 用VHDL语言讲述输出控制器(POC)的设计,这是大学课程的设计-VHDL language used on the output controller (POC) design, This is the design of university courses
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-16
    • 文件大小:33470
    • 提供者:黄小芳
  1. Eat_beans_on_the_8086_games

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  2. 本项目在FPGA上生成8086指令兼容的软核以及外设,并在此基础上跑通pc机上古老但是仍然有趣的吃豆子PACMAN游戏, 作为本科微机原理课程的实验。 通过本项目,学生可以学习到8086的基本结构, 在TurboC下如何进行嵌入式C语言编程,汇编语言, 计算机组成等基本原理, 有独立设计基于8086的SOC软硬件的能力。-The project generated in the FPGA on the 8086 Directive, as well as soft-core-compatible
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-21
    • 文件大小:6281343
    • 提供者:xiaoxu
  1. dianzifayinxt

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  2. vhdl设计用的,可以用于课程设计,帮助完成课程。-vhdl design and curriculum design can be used to help the completion of the course.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-14
    • 文件大小:2838
    • 提供者:天心
  1. chengfa

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  2. 我做的组成原理课程设计!用VHDL实现加法树的乘法。-I do the composition of the principle of curriculum design! VHDL adder tree used to achieve multiplication.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-29
    • 文件大小:41140
    • 提供者:feng
  1. bxfsq

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  2. 用VHDL代码实现的0-40000任意分频,具体分频数可以自己参考进行修改.并用matlab写好各种波形图的MIF文件,然后实现FPGA的一个多功能波形生成器! (平时的课程设计)-Achieved using VHDL code 0-40000 arbitrary frequency, the specific sub-frequency reference can be modified. Matlab written by a variety of waveforms of MIF fil
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-01
    • 文件大小:641456
    • 提供者:
  1. 128634vhdl-sirenqiangdaqi

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  2. 多功能电子抢答器vhdl 计算机专业课程设计必备。初学者的好帮手。-Answer vhdl electronic multi-function devices required computer science curriculum design. Good help for beginners.
  3. 所属分类:SCM

    • 发布日期:2017-04-17
    • 文件大小:160075
    • 提供者:刘蕾
  1. zd

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  2. 我的课程设计内容的一部分 很好用的 vhdl语言 -I am a part of the content of the curriculum design using vhdl language well
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-09
    • 文件大小:845
    • 提供者:africanz
  1. trafficlight

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  2. 数字系统课程设计 基于FPGA的 VHDL编写 交通灯程序。-Digital System Course Design of VHDL-based FPGA program to prepare the traffic lights.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-16
    • 文件大小:463173
    • 提供者:zhoujie
  1. 5933118663955

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  2. 本课程设计主要内容是基于VHDL语言设计的数字闹钟,时分秒新时间及闹钟的设置,设计目的,选题要求,设计要求,思想报告等源程序-The main content of curriculum design is based on the VHDL language design digital alarm clock, when every second time and alarm settings for the new design purpose, topics of requirement
  3. 所属分类:Other systems

    • 发布日期:2017-04-07
    • 文件大小:197990
    • 提供者:maominchao
  1. VHDL

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  2. VHDL和数字电路设计课程实验指导,内容丰富-VHDL and digital circuit design course experiment guide, rich in content
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-01
    • 文件大小:566269
    • 提供者:杨毅刚
  1. VHDL_digital_lock_design

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  2. VHDL课程的源代码数字密码锁的设计与实现的实验报告,内附源代码-VHDL source code for the course digital code lock design and implementation of the experimental report, included the source code
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-02
    • 文件大小:4126
    • 提供者:CXJ
  1. experiment6

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  2. VHDL课程实验6,数控分频器的设计。对应不同的输入信号,预置数(初始计数值)设定不同的值,计数器以此预置数为初始状态进行不同模值的计数,当计数器的状态全为1时,计数器输出溢出信号。用计数器的溢出信号作为输出信号或输出信号的控制值,使输出信号的频率受控于输入的预置数-VHDL course experiment 6, NC Divider. Corresponding to different input signals, the set value (initial count) to set
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-24
    • 文件大小:190176
    • 提供者:童长威
  1. DDSreport

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  2. 使用VHDL语言完成DDS的详细设计,可以作为课程设计使用-Using the VHDL language to complete the detailed design of DDS can be used as a curriculum design
  3. 所属分类:Project Design

    • 发布日期:2017-04-06
    • 文件大小:416801
    • 提供者:tuxiang
  1. the-CourseExercise-of-exchange-theory

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  2. 交换课程设计,用软件实现各模块的连接,电话铃音等-realizing the telephone ringing and etc,based on VHDL
  3. 所属分类:Project Design

    • 发布日期:2017-04-03
    • 文件大小:555121
    • 提供者:LI
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